Hasil Pencarian  ::  Simpan CSV :: Kembali

Abstrak :
Motor stepper merupakan aktuator yang kita ketahui banyak diaplikasikan dalam sistem komputer. Penggunaannya, terutama untuk disk drive, tidak memerlukan torsi besar dan hanya mengatur sudut-sudut tertentu untuk mendapatkan posisi head yang dikehendaki. Untuk menggerakkan motor stepper diperlukan masukan data paralel (umumnya ada empat masukan ditambah ground). Masing-masing masukan mendapat sinyal yang berbeda tapi berurutan satu sama lain. Masing-masing masukan mendapat sinyal pulsa yang berasal dari rangkaian driver / switching yang biasanya dibangun dari transistor. Umumnya perintah (sinyal masukan) untuk menggerakkan motor stepper tersebut dikeluarkan oleh komputer dalam bentuk data seri. Sehingga diperlukan satu rangkaian untuk mengubah data seri tersebut menjadi data paralel yang bisa dibaca oleh motor stepper. Rangkaian tersebut adalah SIPO (Serial In Parallel Out). Model ini mencoba untuk membuat rancangan layout CMOS dari paduan antara rangkaian SIPO dengan driver stepper. Layout SIPO ini dibangun dari beberapa rangkaian D flip-flop. Layout driver kemudian dicoba untuk digabungkan dengan layout SIPO dalam satu layout dalam beberapa alternatif rangkaian. Dari alternatif-alternatif layout yang dibuat, luas layout dan tanggapan waktunya kemudian dibandingkan untuk mendapatkan hasil yang terbaik. Perancangan layout ini menggunakan software "Magic CAD" untuk menggambar layout rancangan dan "IRSIM" untuk mensimulasikan hasil rancangan. Proses penggambaran layout dan simulasi hasil rancangan ini dilakukan di Lab. Elektronika Fakultas Teknik UI selama bulan Desember 2003 sampaiJanuari 2004.

---

Stepper motor is actuator as we knew has a lot of aplication in computer system field. The aplications, especially for disk drive, doesn't need large torque and only set a certain angle to achieve a certain position. To drive the motor stepper we need parallel data input (usually 4 inputs and I ground). Each of inputs gets sequencely different signal. Each of them has pulse signal that comes from driver/switching circuit which be built by transistors. The command (input signal) to drive that motor stepper usually is yielded by computer in serial data form. Then we need one circuit to convert serial data to be a parallel data that can be read by stepper motor. The circuit is called SIPO (Serial In Parallel Out). This paper is trying to make a CMOS layout design of SIPO and stepper driver combination. The SIPO layout is built from some D flip-flop. Then driver layout is combined with SIPO in one layout within several circuit. From this several layout alternative, the layout wide and time respon will be compared to get the best result. This layout design use "Magic CAD" software for layout drawing and "IRSIM" to simulate the design result. Layout drawing process and result of design simulation had done in the Laboratory of Electronic of Engineering Faculty of Indonesia University since December 2003 until January 2004.

Abstrak :
Perancangan VLSI dengan hybrid VHDL merupakan metode desain untuk menghasilkan Sistem On Chip yang berbasis FPGA Xilinx Spartan 3. Sistem yang di desain adalah arsitektur CPU yang terdapat di Ocean Bottom Unit (OBU) Tsunami Early Warning System. Proses desain di implementasikan pada FPGA board Xilinx Spartan 3. Perancangan VLSI CPU OBU dengan metode hybrid VHDL di lakukan dengan urutan proses desain yaitu membuat kode VHDL untuk menyimpan data pengukuran dan mengolah dengan algoritma mofjeld, Mengubah kode VHDL menjadi RTL, Mengubah RTL menjadi schematic dan kode verilog, Mengubah verilog menjadi CMOS layout, Menggunakan kode VHDL sebagai configure device pada XC3S200, genetrate PROM file pada XCF02S. Hasil rancangan adalah VLSI 0,25 μm pada CPU OBU dengan jumlah gerbang logika yang digunakan sebanyak 699 buah dan 347 buah flipflop. Sedangkan dalam teknologi VLSI kapasitas adalah 10k -1M. Dengan metode hybrid VHDL jumlah gate pada desain CPU OBU masih dapat ditingkatkan dengan cara meningkatkan memori simpan sebanyak mungkin. ...... VLSI design with a hybrid VHDL is a design methods to produce a System On Chip based on CMOS layout. The designed system is CPU architecture located on Ocean Bottom Unit Tsunami Early Warning System. The design process implemented on Xilinx Spartan 3 FPGA board. Design of VLSI OBU CPU with a hybrid VHDL method is done by order of the design process is to make VHDL code for storing and processing the measurement data with the algorithm mofjeld, Changing the VHDL code into RTL, Changing RTL into schematic and verilog file, Changing verilog code into CMOS layout, Using the VHDL code as configure devices on the XC3S200, generating PROM files on XCF02S Xilinx Spartan. The design results is VLSI 0,25 μm in CPU OBU with 699 logic gates and 347 flip-flops. While in VLSI technology the capacity is 10k-1M. With a hybrid method the gate of CPU OBU can be increased by increasing the memory as much as possible.